Verification By Error Modeling Using Testing Techniques In Hardware Verification

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This Book Presents The Basis For Reusing The Test Vector Generation And Simulation For The Purpose Of Implementation Verification, To Result In A Significant Timesaving. It Brings The Results In The Direction Of Merging Manufacturing Test Vector Generation And Verification.
  • Marque: Springer Nature B.V
  • Catégorie: Informatique et Internet
  • Auteur: Katarzyna Radecka
  • Nombre de pages: 236
  • Date de publication: 2003-11-30
  • Editeur / Label: Springer Nature B.V
  • Format: Hardcover
  • Langue: English
  • Identifiant Fruugo: 557022043-1125287380
  • ISBN: 9781402076527
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